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Juste publié ! Intel® Xeon Phi™ Coprocessor High Performance Programming 
Apprenez les fondements de la programmation pour cette nouvelle architecture et les nouveaux produits. Nouveau !		 Intel® System Studio
Intel® System Studio est une suite exhaustive d’outils intégrés de développement de logiciels qui peut accélérer la mise sur le marché, renforcer la fiabilité des systèmes et améliorer l’efficacité énergétique et les performances. Nouveau !
Au cas où vous l’avez manqué – Rediffusion du webinaire en direct de deux jours
Introduction au développement d’applications hautes performances pour processeurs Intel® Xeon® et coprocesseurs Intel® Xeon Phi™.		 Structured Parallel Programming
Les auteurs Michael McCool, Arch D. Robison et James Reinders utilisent une approche basée sur des modèles structurés qui devrait rendre le sujet accessible à tous les développeurs de logiciels.

Optimisez les performances de vos applications grâce à la programmation parallèle et avec l'aide des ressources novatrices d'Intel.

Ressources de développement

Outils de développement

  

Intel® Parallel Studio ›

Intel® Parallel Studio, qui apporte aux développeurs Microsoft Visual Studio* C/C++ un traitement parallèle de bout en bout simplifié, fournit des outils avancés permettant d’optimiser les applications clientes pour un traitement multicœur et à nombreux cœurs.

Produits Intel® de développement logiciel ›

Explorez tous les outils qui vous aideront à optimiser vos applications pour l’architecture Intel. Certains outils sont disponibles pour une période d’évaluation gratuite de 45 jours.

Base de connaissances sur les outils ›

Trouvez des guides et des informations d'assistance sur les outils Intel.
21-mai-2012
11:09 AM PDT
Petit panorama de la programmation parallèle
By VinceRev0
Description des principales méthodes utilisées pour paralléliser une application.
04-avr-2012
3:05 AM PDT
Liste de vidéos de cours sur la programmation parallèle
By anthony-charbon...1
Programmation parallele
27-mar-2012
7:42 AM PDT
Guide pour le parallélisme
By anthony-charbon...0
  Voici donc un guide complet qui vous aidera dans votre quête d'optimisation pour les applications parallélisées. Du simple débutant, à l'utilisateur avancé, tout le monde pourra y trouver des informations intéressantes. . . .
21-mar-2012
6:08 AM PDT
Concours Acceler8
By anthony-charbon...0
Accueil Inscription Règles . . .

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Maximum Subarray Problem - Simple Parallelization and Optimizations
By neshonePosted Décembre 22nd 20110
Maximum Subarray Problem - Simple Parallelization and OptimizationsUniversity of Novi Sad Faculty of Technical Sciences, Department of Computing and Controlauthors: Predrag Ilkic, Nenad JovanovicDate: October 15th 2011 - November 15th 2011Introduction:This article is an explanation of our ...
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neshone
Maximum Subarray Problem using TBB and Pipelines
By ph0bPosted Décembre 16th 20110
Algorithm Kadane 2d's classic algorithm has a complexity of O(r²c), where r is the number of rows and c the number of cols. We use it when there is more columns than rows, but instead of tranposing the matrix for the opposite case, we developed a second algorithm that is O(c²r). It's basically a ...
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ph0b
Subarray Problem - A static NUMA-Aware approach
By krahnackPosted Novembre 24th 20113
SubarrayThe subarray problem on a n*m matrix is sequentially solved using an algorithm known as the Kadane 2D algorithm. This algorithm has a O(n²m) complexity. The sequential algorithm is written using 3 loops : for i in (0..n) // <- We parallelize that for j in (i..n ...
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krahnack
Introduction aux "Ranges" des TBB
By megraPosted Novembre 22nd 20110
Bonjour à tous, Je vais vous présenter une fonctionnalité de la bibliothèque TBB que j'ai eu l'occasion de découvrir durant le concours Acceler8. Pour rappel, ...
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megra

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Roman Dementiev...ven, Juin 7th 2013 - 6:56
Resources about Intel® Transactional Synchronization Extensions (Intel TSX)4
Hi, you might find this collection of technical material about Intel TSX instructions useful: http://www.intel.com/software/tsx ...
Roman Dementiev...mer, Juin 5th 2013 - 2:29
Recommendations for Intel(r) Transactional Synchronization Extensions have been published8
Hi, Chapter 12 of the most recent (June 2013) "Intel 64 and IA-32 Architectures Optimization Reference Manual" contains enabling and tuning recommendations for Intel ...
mjcven, Mai 24th 2013 - 11:42
parallel parallel for overhead in OpenMP22
I have written a function that incurs a tremendous amount of overhead in [OpenMP dispatcher] called by [OpenMP fork] called on behalf of a particular parallel region of mine, according to VTune. That fork accounts for roughly a third of all CPU time in my program. My code is as follows. My ...
Michael G.jeu, Mai 23rd 2013 - 12:24
L3 Cache Mapping on Nehalem (Xeon X3430)2
Hello Developers, I am working on a project that involves manipulating the physical memory addresses assigned to a process in order to reduce cache line eviction on a third level (shared L3) cache.  This essentially comes down to partitioning the l3 via software means.  For this project I am using ...

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