Zona para desarrolladores Intel®:
Software Tuning, Performance Optimization & Platform Monitoring

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Discussion around topics such as monitoring and software tuning methodologies, Performance Monitoring Unit (PMU) of Intel microprocessors, software characterization, software optimization techniques for performance and power/energy, monitoring CPU core and graphics processors and other system coprocessors as well asimmerging runtime usages for software metering and quality of service.
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Tema / Iniciador del tema Fecha del envío Respuestas Último envío
Tema regular feasibility of an application on atom processor
por Sridevi B.
Dom, 13/07/2014 - 03:22 3
por Sridevi B.
Vie, 18/07/2014 - 04:20
Tema regular [PCM] Compilation fails when using VS 13
por Thomas Willhalm...
Jue, 11/06/2015 - 00:38 0
por Thomas Willhalm...
Jue, 11/06/2015 - 00:38
Tema regular Write Combine and non-temporal store's effect on IMC uncore events in Haswel-EX
por wang c.
Jue, 14/04/2016 - 07:12 9
por wang c.
Jue, 23/06/2016 - 08:23
Tema regular Counting number of uops
por Ayaz A.
Mié, 22/02/2017 - 10:19 3
por McCalpin, John
Vie, 24/02/2017 - 08:51
Tema regular Does EIST_TRANS work on Sandy Bridge?
por Alexander Alexeev
Lun, 19/08/2013 - 06:40 7
por Patrick Fay (Intel)
Sáb, 24/08/2013 - 18:07
Tema regular Intel PCM and CPU hotplug Issue
por raoufeh
Lun, 23/04/2012 - 11:15 1
por Roman Dementiev...
Mar, 24/04/2012 - 08:45
Tema regular sandy bridge cache architecture
por oliver_cscs
Jue, 06/09/2012 - 05:01 3
por McCalpin, John
Mar, 25/09/2012 - 10:21
Tema regular How to find out whether the last-level cache is shared between CPU and GPU?
por Bo W.
Lun, 20/10/2014 - 23:09 3
por iliyapolak
Mar, 21/10/2014 - 07:42
Tema regular Intel Performance Counter Monitor (Intel PCM) 2.9 released
por Thomas Willhalm...
Lun, 17/08/2015 - 08:32 3
por Carlos V. (Intel)
Vie, 04/12/2015 - 09:47
Tema regular Monitoring C1 and C1E core c-state
por Daniele C.
Mié, 20/07/2016 - 05:29 1
por McCalpin, John
Mié, 20/07/2016 - 06:53
Tema regular CR0 register, CD bit
por Urs M.
Mié, 28/06/2017 - 08:56 2
por Urs M.
Mié, 05/07/2017 - 09:45
Tema regular Docs on Memory Controller PCI Configuration Space
por Wei W.
Lun, 07/10/2013 - 13:10 10
por iliyapolak
Jue, 10/10/2013 - 09:05
Tema regular Inefficient assembler code generated for a simple while-loop?
por tj1
Mar, 03/07/2012 - 06:13 2
por tj1
Mié, 04/07/2012 - 02:50
Tema regular Sandybridge processors report incorrect core number?
por Liam McSherry
Sáb, 29/12/2012 - 10:42 7
por Liam McSherry
Sáb, 29/12/2012 - 14:28
Tema regular not counted when trying PEBS with perf
por Zhu G.
Sáb, 07/02/2015 - 07:31 3
por Patrick Fay (Intel)
Sáb, 25/04/2015 - 07:24
Tema regular Skylake cache latencies slower than Haswell?
por T C
Jue, 12/11/2015 - 16:13 1
por McCalpin, John
Sáb, 14/11/2015 - 09:33
Tema regular Cache and AVX
por Gil S.
Sáb, 15/10/2016 - 09:42 3
por Gil S.
Mié, 19/10/2016 - 10:24
Tema regular Monitoring PCIe Data for Xeon E5-2600
por funksoulbr
Dom, 02/02/2014 - 05:16 2
por funksoulbr
Lun, 03/02/2014 - 02:17
Tema regular Difference between "CPU_CLK_UNHALTED.CORE" and "CPU_CLK_UNHALTED.REF"
por Xia Z.
Jue, 18/04/2013 - 00:53 8
por iliyapolak
Jue, 10/10/2013 - 22:35
Tema regular Ideal vectorization speed-up with SSE2 and MIC512 - not AVX?
por CK
Jue, 09/04/2015 - 07:48 4
por CK
Vie, 10/04/2015 - 02:31
Tema regular IMC and remote memory nodes
por Babis C.
Mar, 16/02/2016 - 03:20 4
por Babis C.
Mar, 16/02/2016 - 13:42
Tema regular TSCs per logical processor? Per socket?
por Corey R.
Jue, 22/12/2016 - 01:54 6
por Corey R.
Dom, 25/12/2016 - 21:57
Tema regular Intel PCM - Can not access CPUs Model Specific Registers MSR
por Mahieddine D.
Mié, 28/05/2014 - 08:52 7
por Patrick Fay (Intel)
Jue, 28/05/2015 - 06:19
Tema regular The event CYCLE_ACTIVITY.STALLS_LDM_PENDING and CYCLE_ACTIVITY.STALLS_L1D_PENDING
por Yanjing Z.
Sáb, 29/06/2013 - 07:40 1
por iliyapolak
Lun, 01/07/2013 - 10:09
Tema regular Package Power of Intel SB
por Fabian Oboril
Dom, 13/11/2011 - 04:30 2
por Patrick Fay (Intel)
Vie, 18/11/2011 - 06:07
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