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Virtualização

Comunidade de desenvolvedores de virtualização Intel®

Desenvolvedor, aproveite as vantagens do Intel® VT. Entre em contato com nossos blogueiros no fórum e diga-nos o que é importante para você. Informe-nos o que você tem conseguido e que oportunidades nós devemos disponibilizar para que este site e as ferramentas dele sejam mais úteis para as suas necessidades.

  • Para começar
    • Tecnologias inteligentes de enfileiramento para virtualização Novas adições e o que ainda é relevante
    • Base de virtualização Novo
    • Glossário de tecnologias de virtualização
    • Modelos de uso de virtualização
    • Tutorial: Criar uma máquina virtual em VMware*
    • Por que os fornecedores de software precisam se preocupar com a virtualização
    • Tecnologia de virtualização Intel® para E/S direcionada (VT-d): Melhorando as plataformas Intel para a virtualização eficiente de dispositivos de E/S

    • Algumas siglas úteis

      ATA Application Targeted Accelerators (Aceleradores direcionados a aplicativos)
      BMC Baseboard management Controller (controlador de gerenciamento de baseboard)
      Boxboro Plataforma do Nehalem EX (processador Intel® Xeon® série 7500 e Tukwilla)
      DCM Data Center Manager (Gerenciador de data centers)
      EP Efficient Performance (desempenho eficiente)
      EPT Extended Page Tables (Tabelas de páginas estendidas)
      ESI Enterprise Southbridge Interface (Interface Enterprise Southbridge)
      EX Expandable Server (servidor expansível)
      FBD Fully Buffered DIMM (DIMM com buffer completo)
      GT/s Giga transferências por segundo
      HA Agente interno ("Home Agent") em sistemas baseados em QPI
      ICH IO controller hub (hub controlador de E/S)
      IMC Integrated Memory Controller (controlador integrado de memória)
      IOH IO hub (hub de E/S)
      L1, L2 Respectivamente, os caches de primeiro e segundo níveis
      LA Land Grid Array (um tipo de encapsulamento de chip)
      LLC Cache de último nível ("Last Level Cache") (em cada chip) ou cache de maior latência ("Longest Latency Cache")
      MC Missão crítica ("Mission Critical") ou Multi-core
      MC Memory controller (controlador de memória)
      ME Manageability engine (mecanismo de gerenciamento)
      NM Node Manger (gerenciador de nós)
      NUMA Non-uniform Memory Access (acesso de memória não uniforme)
      OEM Original Equipment Manufacturer (fabricante original do equipamento)
      PCI Peripheral Component Interface (especificação)
      QPI Quick Path Interconnect (links ponto a ponto)
      RAS Reliability, Availability, Serviceability (Confiabilidade, Disponibilidade, Capacidade de serviço)
      RMCP Remote Monitoring and Control Protocol (Protocolo de controle e monitoramento remoto)
      SCTP Stream Control Transmission Protocol (Protocolo de transmissão e controle de fluxo)
      SDDC Single Device Data Correction (Correção de dados de um único dispositivo)
      SKU Stock Keeping Unit (Unidade de manutenção de estoque (variante de produto))
      SMB Scalable Memory Buffer (Buffer de memória escalonável)
      SMB SMBus System Management Bus (Barramento de gerenciamento do sistema)
      SMI Scalable Memory Interface (Interface de memória escalonável)
      Threads SMT Simultaneous Multi-threading Threads (Threads de multithread simultâneo) ou CPUs de hardware em cada núcleo ou core (2 se habilitado, 1 se não habilitado)
      SSExy geração xy de instruções vetoriais (extensões SIMD de streaming)
      TDP Thermal Design Power (Potência térmica do design)
      TPM Trusted Platform Module (Módulo de plataforma confiável)
      TPV Third Party Vendor (Fornecedor terceirizado)
      Turbo Tecnologia que permite o funcionamento de um ou mais cores (núcleos) em frequência mais alta
      TXT Trusted Execution Technology (Tecnologia de funcionamento confiável)
      Tylersburg Plataforma do Nehalem EP (Processador Intel® Xeon® série 5500) e Westmere EP (Processador Intel® Xeon® série 5600)
Intel® System Studio 2014 - Articles Archive
Por Noah Clemons (Intel)Publicado em 02/19/20140
Overview What's New Overview Detailed New Feature Overview Intel® System Studio 2014 for Linux* - System Requirements Intel® System Studio - Perfect Fit for Wind River* Linux* (PDF) Build and Design for Performance Using Intel® Compiler in Eclipse* for Wind River* Linux* Devel...
Intel® Xeon® Processor E5-2600 V2 Product Family Technical Overview
Por Sreelekshmy Syamalakumari (Intel)Publicado em 10/04/20133
Download Article Intel® Xeon® Processor E5-2600 V2 Product Family Technical Overview [PDF 780KB] Contents Executive Summary Introduction Intel Xeon processor E5-2600 V2 product family enhancements Intel® Secure Key (DRNG) Intel® OS Guard (SMEP) Intel® Advanced Vector Extensions (Intel® AVX): Floa...
Intel® System Studio 2014 for Linux* BETA - Release Notes
Por robert-mueller-albrecht (Intel)Publicado em 09/28/20130
This page provides the current Release Notes for the Intel® System Studio 2014 BETA product. To get product updates, log in to the Intel® Software Development Products Registration Center. For questions or technical support, visit Intel® Software Products Support. Intel® System Studio 2014 BET...
Intel® System Studio 2014 for Linux* - Solutions, Tips and Tricks
Por robert-mueller-albrecht (Intel)Publicado em 09/28/20130
Overview What's New Overview Detailed New Feature Overview Intel® System Studio 2014 for Linux* - System Requirements Intel® System Studio - Perfect Fit for Wind River* Linux* (PDF) Build and Design for Performance Using Intel® Compiler in Eclipse* for Wind River* Linux* Devel...
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How to enable virtualization in intel dual core processor E5400
Por Jonathan A.1
How to enable virtualization in intel dual core processor E5400 Please help me in doing this Mother board is DG41RQ
vt-d posted interrupts support
Por Rakesh B.0
Hello,         I have the S2600CP server board with cpu "Intel(R) Xeon(R) CPU E5-2620 v2 @ 2.10GHz" which supports for APICv, I had patched the linux kernel source 3.18.0 to support vt-d posted interrupts on direct assigned devices, Given in lkml "http://thread.gmane.org/gmane.linux.kernel.iommu/7708".         I had checked the vt-d specification document[1] that describes "Remapping hardware support for interrupt-posting capability is reported through the Posted Interrupt Support (PI) field in the Capability register (CAP_REG)", In which it returns as the posted interrupt is not supported.  The assigning the ixgbe network device is been done via VFIO assignment method.         [1] http://www.intel.com/content/www/us/en/intelligent-systems/intel-technology/vt-directed-io-spec.html         Does the above hardware support vt-d posted interrupt for direct assigned device assignment or it requires any hardware to do this.   Thanks Rakesh
Intel VT-D and Intel X99 motherboards
Por Ward H.0
Hi, I am thinking of buying a X99 motherboard that I can use for Vmware Workstation. The two brands that I am thinking of are ASUS and GigaByte. I have been looking into the Virtualization and plan on running VMWare Workstation 11.  So virtualize windows Server 2012, Windows 8.1 etc. Plus VMWare ESXi. So I think for the last one I need Vt-d. Now I have notice the the ASUS MB's have a few more options for VTD like: Vtd Azalea VCp optimizations. Interrupt Remapping Coherency Support (Non-ISoch) Coherency Support (ISoch) However the GigaByte board only allows me to turn VT-d on and off. So since I can't control these options would they be on by default on the GigaByte, is there anything 'Disadvantage' I have not being able to control them? (Or is all this a bit of a non-issue ?) BTW - I can understand people here might not know specifically about VMWare or the motherboards in question. For example I am wondering if say a board supports VT-d means that these options are inclu...
RSM and multiple cores
Por MP1
Hi all, I am trying to understand a technology that makes use of SMM in relation to hypervisors (hypercheck), and I have a number of questions about SMM in general - I hope I am posting in the right forum. I'd be interested to understand the following: 1) I know that on SMI asserting, all cores (at different interruptible boundaries) will enter SMM: are there spurious cases where SMM is triggered on only less cores? 2) The RSM instruction is said to return the processor to the not-SMM state. Does it need to be executed on every processor in SMM mode? 3) If I am in SMM mode with all my cores (i.e. I wait until them all are in SMM with a mutex), if I execute RSM from one core, does it resume normal operations (i.e. the kernel code it was executing) while the others are left in SMM mode? I am asking because the Default Treatment of RSM (33.14.2) is not exactly clear to me in Intel's doc.   Thanks in advance.    
DCBX on XL710
Por Chakravarthy N.1
Hi, I am trying to configure DCBX & ETS on Intel XL710 in Linux. Is it currently supported? dcbtool reports DCBX is not enabled and I could not find other any linux utility to configure ETS. Please let me know , if there is any config guide I can refer to to get it working. Thanks ~Chakri
Assign pages to VT-D devices
Por steven7653
Need some help understanding the theory of operation for implementing Vt-D.  I've been through the manual a couple of times.  The part I'm having trouble understanding is when we assign the page tables to the root complex structures.  How does the guest know which frames it's allowed to assign for DMA use?  The only work around I could think of is to either A do a VMCALL and ask, or B mirror the entire range the guest is allowed to access vie EPT and assign that to the root complex structure as well.     
How to Teach my processor to support hardware virtualization?
Por Aleksey C.2
  My processor (Intel Pentium dual-core T4200) does not support hardware virtualization. Can I solve the problem by any software? Thanks a lot for your advice.
How to handle GUID_ZPixelFormats in graphics card driver with Direct3D DirectDraw and DXVA under XDDM
Por Letian Yi2
Hi all: I'm developing a virtual graphics card driver under XDDM. I have finished the DirectDraw part of the driver, and i can see the DirectDraw is enabled in dxdiag. Now i'm developing the D3D part, but when i handle GUID_ZPixelFormats in DdGetDriverInfo,  DirectDraw is disabled ! Does anyone know how to handle GUID_ZPixelFormats in DdGetDriverInfo ? My code: void DdInitZPixelFormats(PDD_GETDRIVERINFODATA lpGetDriverInfo) {     static const DDPIXELFORMAT g_zfmts[] =     {         {             sizeof(DDPIXELFORMAT), DDPF_ZBUFFER, 0,             { 16 }, { 0 }, { 0x0000ffff }, { 0x00000000 }, { 0x00000000 }         },         {             sizeof(DDPIXELFORMAT), DDPF_ZBUFFER, 0,             { 32 }, { 0 }, { 0x00ffffff }, { 0x00000000 }, { 0x00000000 }         },     };     DWORD num = sizeof(g_zfmts) / sizeof(DDPIXELFORMAT);     DWORD size = sizeof(g_zfmts);     UINT8 *buf = (UINT8 *)lpGetDriverInfo->lpvData;     memcpy(buf, g_zfmts, min(lpGetDriverInfo->dwExpe...
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Contribuidores do fórum

David Ott: Como engenheiro sênior de software do Grupo de Soluções de Software da Intel, o trabalho de David se concentra nos vários aspectos da computação corporativa, inclusive virtualização, eficiência do consumo de energia e segurança. David tem pós graduação e doutorado em Ciência da Computação pela Universidade da Carolina do Norte em Chapel Hill.

Hussam Mousa é engenheiro de software e trabalho no SOTC (System Optimization Technology Center - Centro tecnológico de otimização de sistemas) da Intel. Ele trabalha em análise de desempenho de virtualização, com ênfase em desempenho de E/S para aplicativos corporativos. Ele tem vários artigos publicados sobre análise de desempenho. Ele fez pós graduação na Universidade da Califórnia Santa Bárbara em 2010, e acabou o bacharelado em Ciência da Computação na Universidade Americana do Cairo em 2002. Ele começou a trabalhar na Intel em 2007.

Karthik Narayanan é engenheiro de software na Intel e trabalha com aplicativos corporativos e de gerenciamento, clusters e computação de alta disponibilidade sob demanda, nativa e virtualizada. Ele trabalha há mais de 4 anos na Intel e sua experiência prévia foi obtida em empresas de Nova Iorque e da Índia. Karthik obteve o bacharelado em engenharia na Universidade de Madras, Índia e o mestrado em Ciência da Computação na Universidade de Toledo.